详细说明：数字均衡器是通讯信道抗码间干扰的重要环节,这是一个用vhdl写的代码以及用SYNPLIFY8.0综合的RTL电路图 它包含三个模块FILTER,ERR_DECISION,ADJUST 希望对大家有用.-equalizer communications channel anti-inter-symbol interference an important link This is a use of the VHDL code to write and use SYNPLIFY8.0 integrated RTL circuit which contains 3 module FILTER, ERR_DECISION, ADJUST hope useful for all.

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文件列表(点击判断是否您需要的文件):
  
  equlizer
  ........\accumulator.vhd
  ........\adjust.vhd
  ........\adjust1_mult.vhd
  ........\adjust2_mult.vhd
  ........\adjust3_mult.vhd
  ........\adjust_con.vhd
  ........\cmplcode2.vhd
  ........\equ_pak.vhd
  ........\err_decion.vhd
  ........\filter.vhd
  ........\filter3_coef.vhd
  ........\filter_add.vhd
  ........\filter_coef.vhd
  ........\filter_coef1.vhd
  ........\filter_con.vhd
  ........\filter_shift.vhd
  ........\mult2.vhd
  ........\mult3.vhd
  ........\p_s.vhd
  ........\shift3.vhd
  ........\s_term1.vhd
  ........\s_term2.vhd
  ........\s_term3.vhd