详细说明:基于FPGA的SDRM设计,VERILOG语言写的同步双端口设计文件!!!是一个不错的双口RAM的设计文件!
[allidt_20020616.tar.gz] - idt的双口RAM的读写接口程序,verilog 代码,并且有测试文档
[fifov1.rar] - FIFO(先进先出队列)通常用于数据的缓存和用于容纳异步信号的频率或相位的差异。本FIFO的实现是利用 双口RAM 和读写地址产生模块来实现的.FIFO的接口信号包括异步的写时钟(wr_clk)和读时钟(rd_clk)、 与写时钟同步的写有效(wren)和写数据(wr_data) 、与读时钟同步
[my_fifo_vhdl.zip] - XILINX的FPGA实现的双口RAM源码,可作为dsp\SDRAM和pci桥接作用,可直接使用,实际工程通过。
[verilog_YUYAN.rar] - verilog语言写的同步双端口设计文件!!!是一个不错的双口RAM的设计文件!
[u-uart.zip] - 一个可综合的串并转换接口verilog源代码
[PSpice.rar] - PSpice教程,该教材讲解了PSpice软件在仿真电路分析的使用方法。
[mp3.rar] - mp3文件格式详解,详述了mp3文件的结构及定义。
[8822_LCD.rar] - 本驱动程序是24064液晶(肇庆金鹏产品 型号Ocmj4×15D)上使用 控制器为8822 MCU为89S52 效果很好。可以用于8822控制器上的液晶
[sdram_verilog_lattice.zip] - 已经成功的FPGA 控制的SDRAM控制器代码.只要修改你需要的宽度就可以了.
[dpram_fpga.rar] - 这是我用vhdl语言,在fpga内部做了一个双口RAM的程序。我的邮箱:wleechina@163.com
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[my_fifo_vhdl.zip] - XILINX的FPGA实现的双口RAM源码,可作为dsp\SDRAM和pci桥接作用,可直接使用,实际工程通过。
[verilog_YUYAN.rar] - verilog语言写的同步双端口设计文件!!!是一个不错的双口RAM的设计文件!
[u-uart.zip] - 一个可综合的串并转换接口verilog源代码
[PSpice.rar] - PSpice教程,该教材讲解了PSpice软件在仿真电路分析的使用方法。
[mp3.rar] - mp3文件格式详解,详述了mp3文件的结构及定义。
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[sdram_verilog_lattice.zip] - 已经成功的FPGA 控制的SDRAM控制器代码.只要修改你需要的宽度就可以了.
[dpram_fpga.rar] - 这是我用vhdl语言,在fpga内部做了一个双口RAM的程序。我的邮箱:wleechina@163.com
文件列表(点击判断是否您需要的文件):
基于FPGA技术的存储器设计及其应用,FPGA,双端口RAM,高速存储器,数据采集-中电网.htm
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